Cadence益华电脑宣布，逻辑IC供应商矽统科技（Silicon Integrated System,SiS） 针对其 PC周边与多媒体SoC 设计积极采用 Cadence 解决方案，以加强原有设计自动化之技术，并进一步使自己的产品开发流程最佳化，大幅提高产能并增进获利能力。

　　Cadence 针对矽统科技寻求新降低功耗以及符合特殊SoC设计规格的需求，提供完整数位设计到signoff设计方法。所采用的技术与方法包括完整的数位流程，涵盖逻辑设计到设计实现、客制化/类比流程、验证流程、功耗降低之方法，以及跨设计流程具功耗意识（power-aware）的自动化设计功能。

　　为了满足客户对数位电视及多媒体SoC晶片设计的功耗需求，矽统科技针对低功耗验证采用了 Encounter Conformal Low Power;全晶片设计实现采用了 Encounter 数位设计实现系统； 而在加速功耗最佳化的需求则是运用了 Encounter Power System ;在合成与时序分析方面则采用了 Encounter RTL Compiler 以及 Encounter Timing System .

　　此外，矽统科技也将针对类比、RF、以及混合讯号等复杂的设计需求，纳入 Cadence 的 Virtuoso Multi-Mode Simulation 与 Virtuoso Accelerated Parallel Simulator 的全方位设计、验证以及精确模拟等功能。

　　矽统科技尤其对于广大的Cadence验证IP系列产品感到满意，针对包含 USB 3.0 等以USB为基础的设计，提供了相对应的验证IP.此外， Compliance Management System 以独特的metric-based方法，协助进行protocol 相容性验证自动化。矽统采用这项验证IP作为整个Cadence metric-based验证方法与技术不可或缺的一环。

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